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/utopia/UTPA2-700.0.x/modules/dmx/hal/k7u/tsp/
H A DregTSP.h1085 #define TSP_VID_SRC_MASK 0x01C0 macro
/utopia/UTPA2-700.0.x/modules/dmx/hal/maldives/tsp/
H A DhalTSP.c2491 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (TSP_SRC_FR… in HAL_TSP_PS_Path_Enable()
2635 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (u32Src << … in HAL_TSP_AVFIFO_Src_Select()
2654 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID_SRC_MASK, (u32Src << TSP_VID_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
H A DregTSP.h1117 #define TSP_VID_SRC_MASK 0x000001C0 macro
/utopia/UTPA2-700.0.x/modules/dmx/hal/manhattan/tsp/
H A DregTSP.h1112 #define TSP_VID_SRC_MASK 0x000001C0UL macro
H A DhalTSP.c2728 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (TSP_SRC_FR… in HAL_TSP_PS_Path_Enable()
2871 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (u32Src << … in HAL_TSP_AVFIFO_Src_Select()
2890 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID_SRC_MASK, (u32Src << TSP_VID_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
/utopia/UTPA2-700.0.x/modules/dmx/hal/macan/tsp/
H A DregTSP.h1103 #define TSP_VID_SRC_MASK 0x000001C0UL macro
H A DhalTSP.c2693 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (TSP_SRC_FR… in HAL_TSP_PS_Path_Enable()
2836 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (u32Src << … in HAL_TSP_AVFIFO_Src_Select()
2855 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID_SRC_MASK, (u32Src << TSP_VID_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
/utopia/UTPA2-700.0.x/modules/dmx/hal/mustang/tsp/
H A DregTSP.h1166 #define TSP_VID_SRC_MASK 0x000001C0UL macro
H A DhalTSP.c2582 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (TSP_SRC_FR… in HAL_TSP_PS_Path_Enable()
2789 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (u32Src << … in HAL_TSP_AVFIFO_Src_Select()
2814 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID_SRC_MASK, (u32Src << TSP_VID_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
/utopia/UTPA2-700.0.x/modules/dmx/hal/M7621/tsp/
H A DregTSP.h1170 #define TSP_VID_SRC_MASK 0x000001C0UL macro
H A DhalTSP.c2785 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (TSP_SRC_FR… in HAL_TSP_PS_Path_Enable()
2992 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (u32Src << … in HAL_TSP_AVFIFO_Src_Select()
3017 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID_SRC_MASK, (u32Src << TSP_VID_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
/utopia/UTPA2-700.0.x/modules/dmx/hal/maxim/tsp/
H A DregTSP.h1170 #define TSP_VID_SRC_MASK 0x000001C0UL macro
H A DhalTSP.c2785 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (TSP_SRC_FR… in HAL_TSP_PS_Path_Enable()
2992 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (u32Src << … in HAL_TSP_AVFIFO_Src_Select()
3017 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID_SRC_MASK, (u32Src << TSP_VID_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
/utopia/UTPA2-700.0.x/modules/dmx/hal/maserati/tsp/
H A DregTSP.h1186 #define TSP_VID_SRC_MASK 0x000001C0UL macro
H A DhalTSP.c2863 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (TSP_SRC_FR… in HAL_TSP_PS_Path_Enable()
3069 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (u32Src << … in HAL_TSP_AVFIFO_Src_Select()
3094 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID_SRC_MASK, (u32Src << TSP_VID_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
/utopia/UTPA2-700.0.x/modules/dmx/hal/M7821/tsp/
H A DregTSP.h1186 #define TSP_VID_SRC_MASK 0x000001C0UL macro
H A DhalTSP.c2824 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (TSP_SRC_FR… in HAL_TSP_PS_Path_Enable()
3030 …32_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID_SRC_MASK)| (u32Src << … in HAL_TSP_AVFIFO_Src_Select()
3055 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID_SRC_MASK, (u32Src << TSP_VID_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
/utopia/UTPA2-700.0.x/modules/dmx/hal/curry/tsp/
H A DregTSP.h1016 #define TSP_VID_SRC_MASK 0x01C0 macro
/utopia/UTPA2-700.0.x/modules/dmx/hal/kano/tsp/
H A DregTSP.h1052 #define TSP_VID_SRC_MASK 0x01C0 macro
/utopia/UTPA2-700.0.x/modules/dscmb/hal/kano/nsk2/
H A DregTSP.h1054 #define TSP_VID_SRC_MASK 0x01C0 macro
/utopia/UTPA2-700.0.x/modules/dscmb/hal/k6/nsk2/
H A DregTSP.h1092 #define TSP_VID_SRC_MASK 0x01C0 macro
/utopia/UTPA2-700.0.x/modules/dscmb/hal/k6lite/nsk2/
H A DregTSP.h1062 #define TSP_VID_SRC_MASK 0x01C0 macro
/utopia/UTPA2-700.0.x/modules/dscmb/hal/k7u/nsk2/
H A DregTSP.h1062 #define TSP_VID_SRC_MASK 0x01C0 macro
/utopia/UTPA2-700.0.x/modules/dmx/hal/k6/tsp/
H A DregTSP.h1094 #define TSP_VID_SRC_MASK 0x01C0 macro
/utopia/UTPA2-700.0.x/modules/dmx/hal/k6lite/tsp/
H A DregTSP.h1062 #define TSP_VID_SRC_MASK 0x01C0 macro

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