| /utopia/UTPA2-700.0.x/modules/dmx/hal/k7u/tsp/ |
| H A D | regTSP.h | 1087 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/maldives/tsp/ |
| H A D | halTSP.c | 2542 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (TSP_SRC_F… in HAL_TSP_PS_Path_Enable() 2638 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (u32Src <<… in HAL_TSP_AVFIFO_Src_Select() 2657 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID3D_SRC_MASK, (u32Src << TSP_VID3D_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
|
| H A D | regTSP.h | 1119 #define TSP_VID3D_SRC_MASK 0x00000E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/manhattan/tsp/ |
| H A D | regTSP.h | 1114 #define TSP_VID3D_SRC_MASK 0x00000E00UL macro
|
| H A D | halTSP.c | 2780 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (TSP_SRC_F… in HAL_TSP_PS_Path_Enable() 2874 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (u32Src <<… in HAL_TSP_AVFIFO_Src_Select() 2893 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID3D_SRC_MASK, (u32Src << TSP_VID3D_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/macan/tsp/ |
| H A D | regTSP.h | 1105 #define TSP_VID3D_SRC_MASK 0x00000E00UL macro
|
| H A D | halTSP.c | 2745 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (TSP_SRC_F… in HAL_TSP_PS_Path_Enable() 2839 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (u32Src <<… in HAL_TSP_AVFIFO_Src_Select() 2858 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID3D_SRC_MASK, (u32Src << TSP_VID3D_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/mustang/tsp/ |
| H A D | regTSP.h | 1168 #define TSP_VID3D_SRC_MASK 0x00000E00UL macro
|
| H A D | halTSP.c | 2641 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (TSP_SRC_F… in HAL_TSP_PS_Path_Enable() 2792 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (u32Src <<… in HAL_TSP_AVFIFO_Src_Select() 2817 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID3D_SRC_MASK, (u32Src << TSP_VID3D_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/M7621/tsp/ |
| H A D | regTSP.h | 1172 #define TSP_VID3D_SRC_MASK 0x00000E00UL macro
|
| H A D | halTSP.c | 2844 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (TSP_SRC_F… in HAL_TSP_PS_Path_Enable() 2995 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (u32Src <<… in HAL_TSP_AVFIFO_Src_Select() 3020 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID3D_SRC_MASK, (u32Src << TSP_VID3D_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/maxim/tsp/ |
| H A D | regTSP.h | 1172 #define TSP_VID3D_SRC_MASK 0x00000E00UL macro
|
| H A D | halTSP.c | 2844 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (TSP_SRC_F… in HAL_TSP_PS_Path_Enable() 2995 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (u32Src <<… in HAL_TSP_AVFIFO_Src_Select() 3020 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID3D_SRC_MASK, (u32Src << TSP_VID3D_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/maserati/tsp/ |
| H A D | regTSP.h | 1188 #define TSP_VID3D_SRC_MASK 0x00000E00UL macro
|
| H A D | halTSP.c | 2922 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (TSP_SRC_F… in HAL_TSP_PS_Path_Enable() 3072 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (u32Src <<… in HAL_TSP_AVFIFO_Src_Select() 3097 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID3D_SRC_MASK, (u32Src << TSP_VID3D_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/M7821/tsp/ |
| H A D | regTSP.h | 1188 #define TSP_VID3D_SRC_MASK 0x00000E00UL macro
|
| H A D | halTSP.c | 2883 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (TSP_SRC_F… in HAL_TSP_PS_Path_Enable() 3033 …2_W(&_TspCtrl[0].FIFO_Src, (_HAL_REG32_R(&_TspCtrl[0].FIFO_Src) & ~TSP_VID3D_SRC_MASK)| (u32Src <<… in HAL_TSP_AVFIFO_Src_Select() 3058 _HAL_TSP_CMD_Write_HWPCR_Reg(TSP_VID3D_SRC_MASK, (u32Src << TSP_VID3D_SRC_SHIFT)); in HAL_TSP_AVFIFO_Src_Select()
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/curry/tsp/ |
| H A D | regTSP.h | 1018 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/kano/tsp/ |
| H A D | regTSP.h | 1054 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dscmb/hal/kano/nsk2/ |
| H A D | regTSP.h | 1056 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dscmb/hal/k6/nsk2/ |
| H A D | regTSP.h | 1094 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dscmb/hal/k6lite/nsk2/ |
| H A D | regTSP.h | 1064 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dscmb/hal/k7u/nsk2/ |
| H A D | regTSP.h | 1064 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/k6/tsp/ |
| H A D | regTSP.h | 1096 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|
| /utopia/UTPA2-700.0.x/modules/dmx/hal/k6lite/tsp/ |
| H A D | regTSP.h | 1064 #define TSP_VID3D_SRC_MASK 0x0E00 macro
|