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88 #define APUSYS_AO_CTL (APUSYS_BASE + APU_AO_CTL)89 #define APUSYS_RPC (APUSYS_BASE + APU_RPC)90 #define APUSYS_ACC (APUSYS_BASE + APU_ACC)91 #define APUSYS_PLL (APUSYS_BASE + APU_PLL)92 #define APUSYS_PCU (APUSYS_BASE + APU_PCU)
24 are_entry_addr = APUSYS_BASE + APU_ARE + ARE_REG_SIZE * ARE_ENTRY(entry); in apu_w_are()166 mmio_setbits_32(APUSYS_BASE + APU_ARE, ARE_RCX_AO_EN); in apu_pll_init()167 mmio_setbits_32(APUSYS_BASE + APU_ARE_REG, ARE_RCX_AO_EN); in apu_pll_init()169 mmio_write_32(APUSYS_BASE + APU_ARE + ARE_RCX_AO_CONFIG, ARE_ENTRY(RCX_AO_BEGIN) | in apu_pll_init()200 mmio_clrbits_32(APUSYS_BASE + APU_ARE, 0xFFFU << ARE_VCORE_OFF); in apu_are_init()202 mmio_setbits_32(APUSYS_BASE + APU_ARE, ARE_VCORE_EN); in apu_are_init()203 mmio_setbits_32(APUSYS_BASE + APU_ARE_REG, ARE_VCORE_EN); in apu_are_init()206 mmio_write_32(APUSYS_BASE + APU_ARE + entry, 0); in apu_are_init()226 base = APUSYS_BASE + rpc_lite_base[rpc_lite_idx]; in apu_rpclite_init()236 mmio_clrbits_32(APUSYS_BASE + APU_RPCTOP_MDLA + APU_RPC_SW_TYPE0_OFF, SW_TYPE_MVPU_MDLA_RV); in apu_rpc_mdla_init()
29 #define APUSYS_BASE 0x19000000 macro
24 #define APUSYS_BASE 0x19000000 macro
39 #define APUSYS_BASE (IO_PHYS + 0x09000000) macro