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51 #define GET_BIT(_x, _pos) \ argument52 (((_x) >> (_pos)) & 1)53 #define GET_BITS(_x, _pos_msb, _pos_lsb) \ argument54 (((_x) >> (_pos_lsb)) & ((1 << ((_pos_msb) - (_pos_lsb) + 1)) - 1))201 #define EDID_DETAILED_TIMING_PIXEL_CLOCK(_x) \ argument202 (((((uint32_t)(_x).pixel_clock[1]) << 8) + \203 (_x).pixel_clock[0]) * 10000)207 #define EDID_DETAILED_TIMING_HORIZONTAL_ACTIVE(_x) \ argument208 ((GET_BITS((_x).horizontal_active_blanking_hi, 7, 4) << 8) + \209 (_x).horizontal_active)[all …]
24 #define SDHCI_CTRL2_FLTCLKSEL(_x) ((_x) << 24) argument28 #define SDHCI_CTRL2_LVLDAT(_x) ((_x) << 16) argument36 #define SDHCI_CTRL2_DFCNT_MASK(_x) ((_x) << 9) argument42 #define SDHCI_CTRL2_SELBASECLK_MASK(_x) ((_x) << 4) argument53 #define SDHCI_CTRL4_DRIVE_MASK(_x) ((_x) << 16) argument
14 #define LINKSYSTEM_FLADJ(_x) ((_x) << 1) argument22 #define PHYCLKRST_SSC_REFCLKSEL(_x) ((_x) << 23) argument25 #define PHYCLKRST_SSC_RANGE(_x) ((_x) << 21) argument39 #define PHYCLKRST_FSEL(_x) ((_x) << 5) argument
129 #define MVGBE_DFLT_RXQ(_x) (_x << 1) argument130 #define MVGBE_DFLT_RX_ARPQ(_x) (_x << 4) argument142 #define MVGBE_DFLT_RX_TCPQ(_x) (_x << 16) argument143 #define MVGBE_DFLT_RX_UDPQ(_x) (_x << 19) argument144 #define MVGBE_DFLT_RX_BPDUQ(_x) (_x << 22) argument
151 #define SMC_LEON_SWAP16(_x_) ({ word _x = (_x_); ((_x << 8) | (_x >> 8)); })154 ({ dword _x = (_x_); \155 ((_x << 24) | \156 ((0x0000FF00UL & _x) << 8) | \157 ((0x00FF0000UL & _x) >> 8) | \158 (_x >> 24)); })
19 #define CPU_TO_GT32(_x) ((_x)) argument21 #define CPU_TO_GT32(_x) ( \ argument22 (((_x) & 0xff) << 24) | (((_x) & 0xff00) << 8) | \23 (((_x) & 0xff0000) >> 8) | (((_x) & 0xff000000) >> 24))
19 #define KWGBE_PORT_SERIAL_CONTROL1_REG(_x) \ argument20 ((_x ? KW_EGIGA1_BASE : KW_EGIGA0_BASE) + 0x44c)
22 #define ORION5XGBE_PORT_SERIAL_CONTROL1_REG(_x) \ argument23 ((_x ? ORION5X_EGIGA0_BASE : ORION5X_EGIGA1_BASE) + 0x44c)
188 #define test_devctl_hst_mode(_x) \ argument189 (musb_readb((_x)->mregs, MUSB_DEVCTL)&MUSB_DEVCTL_HM)