1bf719f66SHadi Asyrafi /* 234971f81SJit Loon Lim * Copyright (c) 2019-2022, Intel Corporation. All rights reserved. 3bf719f66SHadi Asyrafi * 4bf719f66SHadi Asyrafi * SPDX-License-Identifier: BSD-3-Clause 5bf719f66SHadi Asyrafi */ 6bf719f66SHadi Asyrafi 7bf719f66SHadi Asyrafi #ifndef CAD_WATCHDOG_H 8bf719f66SHadi Asyrafi #define CAD_WATCHDOG_H 9bf719f66SHadi Asyrafi 10*47ca43bcSSieu Mun Tang #include "socfpga_plat_def.h" 11*47ca43bcSSieu Mun Tang 12bf719f66SHadi Asyrafi #define WDT_REG_SIZE_OFFSET (0x4) 13bf719f66SHadi Asyrafi #define WDT_MIN_CYCLES (65536) 14bf719f66SHadi Asyrafi #define WDT_PERIOD (20) 15bf719f66SHadi Asyrafi 16bf719f66SHadi Asyrafi #define WDT_CR (WDT_BASE + 0x0) 17bf719f66SHadi Asyrafi #define WDT_TORR (WDT_BASE + 0x4) 18bf719f66SHadi Asyrafi 19bf719f66SHadi Asyrafi #define WDT_CRR (WDT_BASE + 0xC) 20bf719f66SHadi Asyrafi 21bf719f66SHadi Asyrafi #define WDT_CCVR (WDT_BASE + 0x8) 22bf719f66SHadi Asyrafi #define WDT_STAT (WDT_BASE + 0x10) 23bf719f66SHadi Asyrafi #define WDT_EOI (WDT_BASE + 0x14) 24bf719f66SHadi Asyrafi 25bf719f66SHadi Asyrafi #define WDT_COMP_PARAM_1 (WDT_BASE + 0xF4) 26bf719f66SHadi Asyrafi #define WDT_COMP_VERSION (WDT_BASE + 0xF8) 27bf719f66SHadi Asyrafi #define WDT_COMP_TYPE (WDT_BASE + 0XFC) 28bf719f66SHadi Asyrafi 29bf719f66SHadi Asyrafi #define WDT_CR_RMOD (0x0) 30bf719f66SHadi Asyrafi #define WDT_CR_EN (0x1) 31bf719f66SHadi Asyrafi 32bf719f66SHadi Asyrafi #define WDT_SW_RST (0x76) 33bf719f66SHadi Asyrafi 34bf719f66SHadi Asyrafi 35bf719f66SHadi Asyrafi void watchdog_init(int watchdog_clk); 36bf719f66SHadi Asyrafi void watchdog_info(void); 37bf719f66SHadi Asyrafi void watchdog_status(void); 38bf719f66SHadi Asyrafi void watchdog_sw_rst(void); 39bf719f66SHadi Asyrafi 40bf719f66SHadi Asyrafi #endif 41