Lines Matching refs:AF11
123 pinmux = <STM32_PINMUX('G', 5, AF11)>, /* ETH_RGMII_CLK125 */
124 <STM32_PINMUX('G', 4, AF11)>, /* ETH_RGMII_GTX_CLK */
125 <STM32_PINMUX('G', 13, AF11)>, /* ETH_RGMII_TXD0 */
126 <STM32_PINMUX('G', 14, AF11)>, /* ETH_RGMII_TXD1 */
127 <STM32_PINMUX('C', 2, AF11)>, /* ETH_RGMII_TXD2 */
128 <STM32_PINMUX('E', 2, AF11)>, /* ETH_RGMII_TXD3 */
129 <STM32_PINMUX('B', 11, AF11)>, /* ETH_RGMII_TX_CTL */
130 <STM32_PINMUX('C', 1, AF11)>; /* ETH_MDC */
136 pinmux = <STM32_PINMUX('A', 2, AF11)>; /* ETH_MDIO */
142 pinmux = <STM32_PINMUX('C', 4, AF11)>, /* ETH_RGMII_RXD0 */
143 <STM32_PINMUX('C', 5, AF11)>, /* ETH_RGMII_RXD1 */
144 <STM32_PINMUX('B', 0, AF11)>, /* ETH_RGMII_RXD2 */
145 <STM32_PINMUX('B', 1, AF11)>, /* ETH_RGMII_RXD3 */
146 <STM32_PINMUX('A', 1, AF11)>, /* ETH_RGMII_RX_CLK */
147 <STM32_PINMUX('A', 7, AF11)>; /* ETH_RGMII_RX_CTL */
174 pinmux = <STM32_PINMUX('G', 5, AF11)>, /* ETH_RGMII_CLK125 */
175 <STM32_PINMUX('G', 4, AF11)>, /* ETH_RGMII_GTX_CLK */
176 <STM32_PINMUX('G', 13, AF11)>, /* ETH_RGMII_TXD0 */
177 <STM32_PINMUX('G', 14, AF11)>, /* ETH_RGMII_TXD1 */
178 <STM32_PINMUX('C', 2, AF11)>, /* ETH_RGMII_TXD2 */
179 <STM32_PINMUX('E', 2, AF11)>, /* ETH_RGMII_TXD3 */
180 <STM32_PINMUX('B', 11, AF11)>, /* ETH_RGMII_TX_CTL */
181 <STM32_PINMUX('C', 1, AF11)>; /* ETH_MDC */
187 pinmux = <STM32_PINMUX('A', 2, AF11)>; /* ETH_MDIO */
193 pinmux = <STM32_PINMUX('C', 4, AF11)>, /* ETH_RGMII_RXD0 */
194 <STM32_PINMUX('C', 5, AF11)>, /* ETH_RGMII_RXD1 */
195 <STM32_PINMUX('H', 6, AF11)>, /* ETH_RGMII_RXD2 */
196 <STM32_PINMUX('H', 7, AF11)>, /* ETH_RGMII_RXD3 */
197 <STM32_PINMUX('A', 1, AF11)>, /* ETH_RGMII_RX_CLK */
198 <STM32_PINMUX('A', 7, AF11)>; /* ETH_RGMII_RX_CTL */
225 pinmux = <STM32_PINMUX('G', 5, AF11)>, /* ETH_RGMII_CLK125 */
226 <STM32_PINMUX('G', 4, AF11)>, /* ETH_RGMII_GTX_CLK */
227 <STM32_PINMUX('B', 12, AF11)>, /* ETH_RGMII_TXD0 */
228 <STM32_PINMUX('G', 14, AF11)>, /* ETH_RGMII_TXD1 */
229 <STM32_PINMUX('C', 2, AF11)>, /* ETH_RGMII_TXD2 */
230 <STM32_PINMUX('E', 2, AF11)>, /* ETH_RGMII_TXD3 */
231 <STM32_PINMUX('G', 11, AF11)>, /* ETH_RGMII_TX_CTL */
232 <STM32_PINMUX('C', 1, AF11)>; /* ETH_MDC */
238 pinmux = <STM32_PINMUX('A', 2, AF11)>; /* ETH_MDIO */
244 pinmux = <STM32_PINMUX('C', 4, AF11)>, /* ETH_RGMII_RXD0 */
245 <STM32_PINMUX('C', 5, AF11)>, /* ETH_RGMII_RXD1 */
246 <STM32_PINMUX('H', 6, AF11)>, /* ETH_RGMII_RXD2 */
247 <STM32_PINMUX('B', 1, AF11)>, /* ETH_RGMII_RXD3 */
248 <STM32_PINMUX('A', 1, AF11)>, /* ETH_RGMII_RX_CLK */
249 <STM32_PINMUX('A', 7, AF11)>; /* ETH_RGMII_RX_CTL */
276 pinmux = <STM32_PINMUX('G', 13, AF11)>, /* ETH1_RMII_TXD0 */
277 <STM32_PINMUX('G', 14, AF11)>, /* ETH1_RMII_TXD1 */
278 <STM32_PINMUX('B', 11, AF11)>, /* ETH1_RMII_TX_EN */
280 <STM32_PINMUX('A', 2, AF11)>, /* ETH1_MDIO */
281 <STM32_PINMUX('C', 1, AF11)>; /* ETH1_MDC */
287 pinmux = <STM32_PINMUX('C', 4, AF11)>, /* ETH1_RMII_RXD0 */
288 <STM32_PINMUX('C', 5, AF11)>, /* ETH1_RMII_RXD1 */
289 <STM32_PINMUX('A', 7, AF11)>; /* ETH1_RMII_CRS_DV */
1030 <STM32_PINMUX('G', 10, AF11)>, /* QSPI_BK2_IO2 */
1031 <STM32_PINMUX('G', 7, AF11)>; /* QSPI_BK2_IO3 */
1234 pinmux = <STM32_PINMUX('F', 2, AF11)>, /* SDMMC1_D0DIR */
1236 <STM32_PINMUX('B', 9, AF11)>; /* SDMMC1_CDIR */
1258 pinmux = <STM32_PINMUX('F', 2, AF11)>, /* SDMMC1_D0DIR */
1259 <STM32_PINMUX('E', 14, AF11)>, /* SDMMC1_D123DIR */
1260 <STM32_PINMUX('B', 9, AF11)>; /* SDMMC1_CDIR */